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Power Rail Name | B2B J1 Pins | B2B J2 Pins | B2B J3 Pins | Directions | Note |
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| PL_DCIN | 151, 153, 155, 157, 159 | - | - | Input | - |
| DCDCIN | - | 154, 156, 158, 160, | - | Input | - |
| LP_DCDC | - | 138, 140, 142, 144 | - | Input | - |
| PS_BATT | - | 125 | - | Input | - |
| GT_DCDC | - | - | 157, 158, 159, 160 | Input | - |
| PLL_3V3 | - | - | 152 | Input | U5 (programmable PLL) 3.3V nominal input |
| SI_PLL_1V8 | - | - | 151 | Output | Internal voltage level 1.8V nominal output |
| PS_1V8 | - | 99 | 147, 148 | Output | Internal voltage level |
| PL_1V8 | 91, 121 | - | - | Output | Internal voltage level |
| DDR_1V2 | - | 135 | - | Output | Internal voltage level |
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| Date | Revision | Contributors | Description | ||||||||||||||||||||||||||
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| v.30 | Martin Rohrmüller |
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v.29 | John Hartfiel |
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| v.27 | John Hartfiel |
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| v.26 | John Hartfiel |
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| v.24 | Ali Naseri |
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2017-11-13 | John Hartfiel |
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| 2017-10-20 | v.21 | Ali Naseri |
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| 2017-08-28 | v.15 | John Hartfiel |
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| 2017-08-28 | v.14 | Jan Kumann |
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| 2017-08-15 | v.12 | Vitali Tsiukala | Changed signals count in the B2B connectors table | ||||||||||||||||||||||||||
| 2017-08-15 | v.11 | John Hartfiel, Ali Naseri |
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| 2017-02-06 | v.1 | Jan Kumann | Initial document |
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